Conception d une machine d etats

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description

descriptif du fournisseur
L'évolution des technologies des semi-conducteurs vers des géométries de plus en plus fines permet un accroissement des performances et des fonctionnalités par puce. L'objectif de ce travail est de concevoir une machine d'états en technologie CMOS 0.35 µm on exploitant un style de circuit logiques synchronisé C2MOS. Donc le noyau du circuit est le latch C2MOS qui construire un registre dynamique ingénieux, basé sur le concept maître esclave. La logique C2MOS combine la conception de logique statique avec la synchronisation réalisée en employant des signaux d'horloge
 
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